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使用SystemVerilog进行RTL建模 基于SystemVerilog的ASIC与FPGA设计 本书以示例的形式重点介绍如何使用SystemVerilog在RTL抽象级别对ASIC和FPGA设计进行建模
SystemVerilog验证方法学 [美]伯杰龙(Bergerpm J.) 著;夏宇闻 译 9787811240795 【速开发票,优质售后,支持7天无理由退换】
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